Classic Timing Analyzer report for g07_Nth_Root
Tue Nov 18 15:28:00 2008
Quartus II Version 8.0 Build 215 05/29/2008 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. Timing Analyzer Summary
  3. Timing Analyzer Settings
  4. Clock Settings Summary
  5. Clock Setup: 'CLOCK'
  6. tsu
  7. tco
  8. th
  9. Timing Analyzer Messages



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; Legal Notice ;
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and other software and tools, and its AMPP partner logic 
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; Timing Analyzer Summary                                                                                                                                                                              ;
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; Type                         ; Slack ; Required Time ; Actual Time                      ; From                                        ; To                    ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+-------+---------------+----------------------------------+---------------------------------------------+-----------------------+------------+----------+--------------+
; Worst-case tsu               ; N/A   ; None          ; 5.938 ns                         ; key[0]                                      ; N_input[5]            ; --         ; CLOCK    ; 0            ;
; Worst-case tco               ; N/A   ; None          ; 23.228 ns                        ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2 ; hex0[2]               ; CLOCK      ; --       ; 0            ;
; Worst-case th                ; N/A   ; None          ; 0.541 ns                         ; sw[1]                                       ; N_input[1]            ; --         ; CLOCK    ; 0            ;
; Clock Setup: 'CLOCK'         ; N/A   ; None          ; 90.87 MHz ( period = 11.005 ns ) ; g07_Nth_Root:G0|Z_SHIFT[19]                 ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; 0            ;
; Total number of failed paths ;       ;               ;                                  ;                                             ;                       ;            ;          ; 0            ;
+------------------------------+-------+---------------+----------------------------------+---------------------------------------------+-----------------------+------------+----------+--------------+


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; Timing Analyzer Settings                                                                                           ;
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; Option                                                              ; Setting            ; From ; To ; Entity Name ;
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; Device Name                                                         ; EP2C20F484C7       ;      ;    ;             ;
; Timing Models                                                       ; Final              ;      ;    ;             ;
; Default hold multicycle                                             ; Same as Multicycle ;      ;    ;             ;
; Cut paths between unrelated clock domains                           ; On                 ;      ;    ;             ;
; Cut off read during write signal paths                              ; On                 ;      ;    ;             ;
; Cut off feedback from I/O pins                                      ; On                 ;      ;    ;             ;
; Report Combined Fast/Slow Timing                                    ; Off                ;      ;    ;             ;
; Ignore Clock Settings                                               ; Off                ;      ;    ;             ;
; Analyze latches as synchronous elements                             ; On                 ;      ;    ;             ;
; Enable Recovery/Removal analysis                                    ; Off                ;      ;    ;             ;
; Enable Clock Latency                                                ; Off                ;      ;    ;             ;
; Use TimeQuest Timing Analyzer                                       ; Off                ;      ;    ;             ;
; Number of source nodes to report per destination node               ; 10                 ;      ;    ;             ;
; Number of destination nodes to report                               ; 10                 ;      ;    ;             ;
; Number of paths to report                                           ; 200                ;      ;    ;             ;
; Report Minimum Timing Checks                                        ; Off                ;      ;    ;             ;
; Use Fast Timing Models                                              ; Off                ;      ;    ;             ;
; Report IO Paths Separately                                          ; Off                ;      ;    ;             ;
; Perform Multicorner Analysis                                        ; On                 ;      ;    ;             ;
; Reports the worst-case path for each clock domain and analysis      ; Off                ;      ;    ;             ;
; Removes common clock path pessimism (CCPP) during slack computation ; Off                ;      ;    ;             ;
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; Clock Settings Summary                                                                                                                                                             ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type     ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; CLOCK           ;                    ; User Pin ; None             ; 0.000 ns      ; 0.000 ns     ; --       ; N/A                   ; N/A                 ; N/A    ;              ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+


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; Clock Setup: 'CLOCK'                                                                                                                                                                                                                                            ;
+-----------------------------------------+-----------------------------------------------------+-----------------------------+-----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack                                   ; Actual fmax (period)                                ; From                        ; To                    ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+-----------------------------+-----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A                                     ; 90.87 MHz ( period = 11.005 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.764 ns               ;
; N/A                                     ; 91.55 MHz ( period = 10.923 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.684 ns               ;
; N/A                                     ; 91.98 MHz ( period = 10.872 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.642 ns               ;
; N/A                                     ; 91.99 MHz ( period = 10.871 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.641 ns               ;
; N/A                                     ; 92.08 MHz ( period = 10.860 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.621 ns               ;
; N/A                                     ; 92.30 MHz ( period = 10.834 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.600 ns               ;
; N/A                                     ; 92.78 MHz ( period = 10.778 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.538 ns               ;
; N/A                                     ; 92.78 MHz ( period = 10.778 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.541 ns               ;
; N/A                                     ; 93.02 MHz ( period = 10.750 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.516 ns               ;
; N/A                                     ; 93.12 MHz ( period = 10.739 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.499 ns               ;
; N/A                                     ; 93.22 MHz ( period = 10.727 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.499 ns               ;
; N/A                                     ; 93.23 MHz ( period = 10.726 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.498 ns               ;
; N/A                                     ; 93.48 MHz ( period = 10.698 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.458 ns               ;
; N/A                                     ; 93.49 MHz ( period = 10.696 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.458 ns               ;
; N/A                                     ; 93.55 MHz ( period = 10.689 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.457 ns               ;
; N/A                                     ; 93.84 MHz ( period = 10.657 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.419 ns               ;
; N/A                                     ; 93.94 MHz ( period = 10.645 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.416 ns               ;
; N/A                                     ; 93.95 MHz ( period = 10.644 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.415 ns               ;
; N/A                                     ; 93.95 MHz ( period = 10.644 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.405 ns               ;
; N/A                                     ; 94.18 MHz ( period = 10.618 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.378 ns               ;
; N/A                                     ; 94.20 MHz ( period = 10.616 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.378 ns               ;
; N/A                                     ; 94.24 MHz ( period = 10.611 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.370 ns               ;
; N/A                                     ; 94.28 MHz ( period = 10.607 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.374 ns               ;
; N/A                                     ; 94.29 MHz ( period = 10.606 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.377 ns               ;
; N/A                                     ; 94.30 MHz ( period = 10.605 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.376 ns               ;
; N/A                                     ; 94.30 MHz ( period = 10.605 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.373 ns               ;
; N/A                                     ; 94.63 MHz ( period = 10.568 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.335 ns               ;
; N/A                                     ; 94.65 MHz ( period = 10.565 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.336 ns               ;
; N/A                                     ; 94.66 MHz ( period = 10.564 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.335 ns               ;
; N/A                                     ; 94.68 MHz ( period = 10.562 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.325 ns               ;
; N/A                                     ; 94.78 MHz ( period = 10.551 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.317 ns               ;
; N/A                                     ; 94.81 MHz ( period = 10.547 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.307 ns               ;
; N/A                                     ; 94.86 MHz ( period = 10.542 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.308 ns               ;
; N/A                                     ; 94.89 MHz ( period = 10.538 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.298 ns               ;
; N/A                                     ; 94.91 MHz ( period = 10.536 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.298 ns               ;
; N/A                                     ; 94.94 MHz ( period = 10.533 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.303 ns               ;
; N/A                                     ; 94.99 MHz ( period = 10.527 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.294 ns               ;
; N/A                                     ; 95.03 MHz ( period = 10.523 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.290 ns               ;
; N/A                                     ; 95.03 MHz ( period = 10.523 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.283 ns               ;
; N/A                                     ; 95.14 MHz ( period = 10.511 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.283 ns               ;
; N/A                                     ; 95.15 MHz ( period = 10.510 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.282 ns               ;
; N/A                                     ; 95.17 MHz ( period = 10.508 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.268 ns               ;
; N/A                                     ; 95.18 MHz ( period = 10.506 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.266 ns               ;
; N/A                                     ; 95.21 MHz ( period = 10.503 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.263 ns               ;
; N/A                                     ; 95.37 MHz ( period = 10.485 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.256 ns               ;
; N/A                                     ; 95.38 MHz ( period = 10.484 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.255 ns               ;
; N/A                                     ; 95.38 MHz ( period = 10.484 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.251 ns               ;
; N/A                                     ; 95.48 MHz ( period = 10.473 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.241 ns               ;
; N/A                                     ; 95.50 MHz ( period = 10.471 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.237 ns               ;
; N/A                                     ; 95.54 MHz ( period = 10.467 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.227 ns               ;
; N/A                                     ; 95.55 MHz ( period = 10.466 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.227 ns               ;
; N/A                                     ; 95.55 MHz ( period = 10.466 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.232 ns               ;
; N/A                                     ; 95.63 MHz ( period = 10.457 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.223 ns               ;
; N/A                                     ; 95.64 MHz ( period = 10.456 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.218 ns               ;
; N/A                                     ; 95.72 MHz ( period = 10.447 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.214 ns               ;
; N/A                                     ; 95.72 MHz ( period = 10.447 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.206 ns               ;
; N/A                                     ; 95.76 MHz ( period = 10.443 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.210 ns               ;
; N/A                                     ; 95.76 MHz ( period = 10.443 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.203 ns               ;
; N/A                                     ; 95.90 MHz ( period = 10.428 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.188 ns               ;
; N/A                                     ; 95.93 MHz ( period = 10.424 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.186 ns               ;
; N/A                                     ; 95.94 MHz ( period = 10.423 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.183 ns               ;
; N/A                                     ; 96.01 MHz ( period = 10.416 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.177 ns               ;
; N/A                                     ; 96.10 MHz ( period = 10.406 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.174 ns               ;
; N/A                                     ; 96.11 MHz ( period = 10.405 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.176 ns               ;
; N/A                                     ; 96.12 MHz ( period = 10.404 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.175 ns               ;
; N/A                                     ; 96.18 MHz ( period = 10.397 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.165 ns               ;
; N/A                                     ; 96.26 MHz ( period = 10.389 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.157 ns               ;
; N/A                                     ; 96.26 MHz ( period = 10.388 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.160 ns               ;
; N/A                                     ; 96.27 MHz ( period = 10.387 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.147 ns               ;
; N/A                                     ; 96.30 MHz ( period = 10.384 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.144 ns               ;
; N/A                                     ; 96.40 MHz ( period = 10.373 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.144 ns               ;
; N/A                                     ; 96.41 MHz ( period = 10.372 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.143 ns               ;
; N/A                                     ; 96.46 MHz ( period = 10.367 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.134 ns               ;
; N/A                                     ; 96.50 MHz ( period = 10.363 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.130 ns               ;
; N/A                                     ; 96.50 MHz ( period = 10.363 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.123 ns               ;
; N/A                                     ; 96.51 MHz ( period = 10.362 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.122 ns               ;
; N/A                                     ; 96.64 MHz ( period = 10.348 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.108 ns               ;
; N/A                                     ; 96.67 MHz ( period = 10.345 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.105 ns               ;
; N/A                                     ; 96.68 MHz ( period = 10.343 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.103 ns               ;
; N/A                                     ; 96.76 MHz ( period = 10.335 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.102 ns               ;
; N/A                                     ; 96.77 MHz ( period = 10.334 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.097 ns               ;
; N/A                                     ; 96.84 MHz ( period = 10.326 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.094 ns               ;
; N/A                                     ; 96.88 MHz ( period = 10.322 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.089 ns               ;
; N/A                                     ; 96.89 MHz ( period = 10.321 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.089 ns               ;
; N/A                                     ; 96.92 MHz ( period = 10.318 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.086 ns               ;
; N/A                                     ; 96.95 MHz ( period = 10.315 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.082 ns               ;
; N/A                                     ; 96.97 MHz ( period = 10.312 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.080 ns               ;
; N/A                                     ; 97.00 MHz ( period = 10.309 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.081 ns               ;
; N/A                                     ; 97.02 MHz ( period = 10.307 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.067 ns               ;
; N/A                                     ; 97.03 MHz ( period = 10.306 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.077 ns               ;
; N/A                                     ; 97.05 MHz ( period = 10.304 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.064 ns               ;
; N/A                                     ; 97.07 MHz ( period = 10.302 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.063 ns               ;
; N/A                                     ; 97.23 MHz ( period = 10.285 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.052 ns               ;
; N/A                                     ; 97.25 MHz ( period = 10.283 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.050 ns               ;
; N/A                                     ; 97.25 MHz ( period = 10.283 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.043 ns               ;
; N/A                                     ; 97.25 MHz ( period = 10.283 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.055 ns               ;
; N/A                                     ; 97.26 MHz ( period = 10.282 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.042 ns               ;
; N/A                                     ; 97.26 MHz ( period = 10.282 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.050 ns               ;
; N/A                                     ; 97.28 MHz ( period = 10.280 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.042 ns               ;
; N/A                                     ; 97.31 MHz ( period = 10.276 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.043 ns               ;
; N/A                                     ; 97.39 MHz ( period = 10.268 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.028 ns               ;
; N/A                                     ; 97.40 MHz ( period = 10.267 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.038 ns               ;
; N/A                                     ; 97.40 MHz ( period = 10.267 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.028 ns               ;
; N/A                                     ; 97.44 MHz ( period = 10.263 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.023 ns               ;
; N/A                                     ; 97.47 MHz ( period = 10.260 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.019 ns               ;
; N/A                                     ; 97.51 MHz ( period = 10.255 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[16] ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.015 ns               ;
; N/A                                     ; 97.55 MHz ( period = 10.251 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.018 ns               ;
; N/A                                     ; 97.56 MHz ( period = 10.250 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.011 ns               ;
; N/A                                     ; 97.62 MHz ( period = 10.244 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.011 ns               ;
; N/A                                     ; 97.64 MHz ( period = 10.242 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.009 ns               ;
; N/A                                     ; 97.67 MHz ( period = 10.239 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.006 ns               ;
; N/A                                     ; 97.70 MHz ( period = 10.235 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.002 ns               ;
; N/A                                     ; 97.75 MHz ( period = 10.230 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[41] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.997 ns                ;
; N/A                                     ; 97.76 MHz ( period = 10.229 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 10.000 ns               ;
; N/A                                     ; 97.77 MHz ( period = 10.228 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.999 ns                ;
; N/A                                     ; 97.79 MHz ( period = 10.226 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.997 ns                ;
; N/A                                     ; 97.81 MHz ( period = 10.224 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.984 ns                ;
; N/A                                     ; 97.99 MHz ( period = 10.205 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.972 ns                ;
; N/A                                     ; 98.01 MHz ( period = 10.203 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.964 ns                ;
; N/A                                     ; 98.02 MHz ( period = 10.202 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[35] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.962 ns                ;
; N/A                                     ; 98.04 MHz ( period = 10.200 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.962 ns                ;
; N/A                                     ; 98.04 MHz ( period = 10.200 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.967 ns                ;
; N/A                                     ; 98.13 MHz ( period = 10.191 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.958 ns                ;
; N/A                                     ; 98.13 MHz ( period = 10.191 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.958 ns                ;
; N/A                                     ; 98.14 MHz ( period = 10.190 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.958 ns                ;
; N/A                                     ; 98.18 MHz ( period = 10.185 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.948 ns                ;
; N/A                                     ; 98.22 MHz ( period = 10.181 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.941 ns                ;
; N/A                                     ; 98.22 MHz ( period = 10.181 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.949 ns                ;
; N/A                                     ; 98.28 MHz ( period = 10.175 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[16] ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.935 ns                ;
; N/A                                     ; 98.31 MHz ( period = 10.172 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.944 ns                ;
; N/A                                     ; 98.34 MHz ( period = 10.169 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.937 ns                ;
; N/A                                     ; 98.39 MHz ( period = 10.164 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.931 ns                ;
; N/A                                     ; 98.41 MHz ( period = 10.162 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.929 ns                ;
; N/A                                     ; 98.43 MHz ( period = 10.160 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.932 ns                ;
; N/A                                     ; 98.43 MHz ( period = 10.159 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.926 ns                ;
; N/A                                     ; 98.47 MHz ( period = 10.155 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.922 ns                ;
; N/A                                     ; 98.52 MHz ( period = 10.150 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[40] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.917 ns                ;
; N/A                                     ; 98.53 MHz ( period = 10.149 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.920 ns                ;
; N/A                                     ; 98.54 MHz ( period = 10.148 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.919 ns                ;
; N/A                                     ; 98.56 MHz ( period = 10.146 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.917 ns                ;
; N/A                                     ; 98.58 MHz ( period = 10.144 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.904 ns                ;
; N/A                                     ; 98.61 MHz ( period = 10.141 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.901 ns                ;
; N/A                                     ; 98.68 MHz ( period = 10.134 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.906 ns                ;
; N/A                                     ; 98.69 MHz ( period = 10.133 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[26] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.901 ns                ;
; N/A                                     ; 98.80 MHz ( period = 10.121 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.884 ns                ;
; N/A                                     ; 98.81 MHz ( period = 10.120 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[35] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.882 ns                ;
; N/A                                     ; 98.82 MHz ( period = 10.119 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.880 ns                ;
; N/A                                     ; 98.84 MHz ( period = 10.117 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.877 ns                ;
; N/A                                     ; 98.86 MHz ( period = 10.115 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[11] ; g07_Nth_Root:G0|Z[31] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.876 ns                ;
; N/A                                     ; 98.89 MHz ( period = 10.112 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.872 ns                ;
; N/A                                     ; 98.90 MHz ( period = 10.111 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.878 ns                ;
; N/A                                     ; 98.91 MHz ( period = 10.110 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.878 ns                ;
; N/A                                     ; 98.94 MHz ( period = 10.107 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.874 ns                ;
; N/A                                     ; 98.96 MHz ( period = 10.105 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.873 ns                ;
; N/A                                     ; 98.96 MHz ( period = 10.105 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.873 ns                ;
; N/A                                     ; 99.04 MHz ( period = 10.097 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[34] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.857 ns                ;
; N/A                                     ; 99.05 MHz ( period = 10.096 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.864 ns                ;
; N/A                                     ; 99.05 MHz ( period = 10.096 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.868 ns                ;
; N/A                                     ; 99.06 MHz ( period = 10.095 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[16] ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.855 ns                ;
; N/A                                     ; 99.10 MHz ( period = 10.091 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[19] ; g07_Nth_Root:G0|Z[22] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.845 ns                ;
; N/A                                     ; 99.15 MHz ( period = 10.086 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[10] ; g07_Nth_Root:G0|Z[30] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.847 ns                ;
; N/A                                     ; 99.17 MHz ( period = 10.084 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.851 ns                ;
; N/A                                     ; 99.19 MHz ( period = 10.082 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.849 ns                ;
; N/A                                     ; 99.22 MHz ( period = 10.079 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.846 ns                ;
; N/A                                     ; 99.26 MHz ( period = 10.075 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.842 ns                ;
; N/A                                     ; 99.30 MHz ( period = 10.070 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[39] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.837 ns                ;
; N/A                                     ; 99.30 MHz ( period = 10.070 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.842 ns                ;
; N/A                                     ; 99.31 MHz ( period = 10.069 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[35] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.840 ns                ;
; N/A                                     ; 99.31 MHz ( period = 10.069 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[27] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.837 ns                ;
; N/A                                     ; 99.32 MHz ( period = 10.068 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[35] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.839 ns                ;
; N/A                                     ; 99.34 MHz ( period = 10.066 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.837 ns                ;
; N/A                                     ; 99.36 MHz ( period = 10.064 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.832 ns                ;
; N/A                                     ; 99.48 MHz ( period = 10.052 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.819 ns                ;
; N/A                                     ; 99.54 MHz ( period = 10.046 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[12] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.805 ns                ;
; N/A                                     ; 99.57 MHz ( period = 10.043 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.810 ns                ;
; N/A                                     ; 99.63 MHz ( period = 10.037 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 99.66 MHz ( period = 10.034 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[3]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.805 ns                ;
; N/A                                     ; 99.69 MHz ( period = 10.031 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[35] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.798 ns                ;
; N/A                                     ; 99.73 MHz ( period = 10.027 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[5]  ; g07_Nth_Root:G0|Z[36] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.794 ns                ;
; N/A                                     ; 99.79 MHz ( period = 10.021 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.789 ns                ;
; N/A                                     ; 99.85 MHz ( period = 10.015 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[16] ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.775 ns                ;
; N/A                                     ; 99.88 MHz ( period = 10.012 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.784 ns                ;
; N/A                                     ; 99.91 MHz ( period = 10.009 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[18] ; g07_Nth_Root:G0|Z[22] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.765 ns                ;
; N/A                                     ; 99.93 MHz ( period = 10.007 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[13] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.766 ns                ;
; N/A                                     ; 99.96 MHz ( period = 10.004 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.771 ns                ;
; N/A                                     ; 100.01 MHz ( period = 9.999 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.766 ns                ;
; N/A                                     ; 100.03 MHz ( period = 9.997 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[6]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.765 ns                ;
; N/A                                     ; 100.05 MHz ( period = 9.995 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.763 ns                ;
; N/A                                     ; 100.07 MHz ( period = 9.993 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[2]  ; g07_Nth_Root:G0|Z[22] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.754 ns                ;
; N/A                                     ; 100.07 MHz ( period = 9.993 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[4]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.761 ns                ;
; N/A                                     ; 100.10 MHz ( period = 9.990 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[38] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.757 ns                ;
; N/A                                     ; 100.14 MHz ( period = 9.986 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[1]  ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.758 ns                ;
; N/A                                     ; 100.15 MHz ( period = 9.985 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[9]  ; g07_Nth_Root:G0|Z[24] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.753 ns                ;
; N/A                                     ; 100.16 MHz ( period = 9.984 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[0]  ; g07_Nth_Root:G0|Z[22] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.749 ns                ;
; N/A                                     ; 100.18 MHz ( period = 9.982 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[7]  ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.750 ns                ;
; N/A                                     ; 100.26 MHz ( period = 9.974 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[25] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.735 ns                ;
; N/A                                     ; 100.28 MHz ( period = 9.972 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[8]  ; g07_Nth_Root:G0|Z[33] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.739 ns                ;
; N/A                                     ; 100.31 MHz ( period = 9.969 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[15] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.739 ns                ;
; N/A                                     ; 100.32 MHz ( period = 9.968 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[20] ; g07_Nth_Root:G0|Z[37] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.728 ns                ;
; N/A                                     ; 100.33 MHz ( period = 9.967 ns )                    ; g07_Nth_Root:G0|Z_SHIFT[14] ; g07_Nth_Root:G0|Z[32] ; CLOCK      ; CLOCK    ; None                        ; None                      ; 9.737 ns                ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ;                             ;                       ;            ;          ;                             ;                           ;                         ;
+-----------------------------------------+-----------------------------------------------------+-----------------------------+-----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+


+--------------------------------------------------------------------+
; tsu                                                                ;
+-------+--------------+------------+--------+------------+----------+
; Slack ; Required tsu ; Actual tsu ; From   ; To         ; To Clock ;
+-------+--------------+------------+--------+------------+----------+
; N/A   ; None         ; 5.938 ns   ; key[0] ; N_input[2] ; CLOCK    ;
; N/A   ; None         ; 5.938 ns   ; key[0] ; N_input[4] ; CLOCK    ;
; N/A   ; None         ; 5.938 ns   ; key[0] ; N_input[3] ; CLOCK    ;
; N/A   ; None         ; 5.938 ns   ; key[0] ; N_input[5] ; CLOCK    ;
; N/A   ; None         ; 5.488 ns   ; key[1] ; N_input[2] ; CLOCK    ;
; N/A   ; None         ; 5.488 ns   ; key[1] ; N_input[4] ; CLOCK    ;
; N/A   ; None         ; 5.488 ns   ; key[1] ; N_input[3] ; CLOCK    ;
; N/A   ; None         ; 5.488 ns   ; key[1] ; N_input[5] ; CLOCK    ;
; N/A   ; None         ; 5.438 ns   ; key[3] ; resetS     ; CLOCK    ;
; N/A   ; None         ; 5.438 ns   ; key[3] ; startS     ; CLOCK    ;
; N/A   ; None         ; 5.332 ns   ; key[0] ; N_input[1] ; CLOCK    ;
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; N/A   ; None         ; 5.325 ns   ; key[0] ; startS     ; CLOCK    ;
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+-------+--------------+------------+--------+------------+----------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; tco                                                                                                                                                                              ;
+-----------------------------------------+-----------------------------------------------------+------------+----------------------------------------------+---------+------------+
; Slack                                   ; Required tco                                        ; Actual tco ; From                                         ; To      ; From Clock ;
+-----------------------------------------+-----------------------------------------------------+------------+----------------------------------------------+---------+------------+
; N/A                                     ; None                                                ; 23.228 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.879 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.744 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.675 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.641 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.614 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.462 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.442 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.395 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.326 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.292 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.204 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.130 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.113 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.102 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2  ; hex0[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.096 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[4]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.061 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 22.027 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.988 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.958 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.905 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[7]~_Duplicate_2  ; hex0[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.889 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.855 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex0[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.855 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.848 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.753 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex0[6] ; CLOCK      ;
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; N/A                                     ; None                                                ; 21.590 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[3] ; CLOCK      ;
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; N/A                                     ; None                                                ; 21.504 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.488 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex0[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.435 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.421 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[7]~_Duplicate_2  ; hex0[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.418 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex0[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.401 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex0[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 21.352 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[7]~_Duplicate_2  ; hex0[1] ; CLOCK      ;
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; N/A                                     ; None                                                ; 18.081 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 18.074 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[9]~_Duplicate_2  ; hex0[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 18.054 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[17]~_Duplicate_2 ; hex3[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 18.007 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[12]~_Duplicate_2 ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.959 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[7]~_Duplicate_2  ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.949 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[15]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.930 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[0]~_Duplicate_2  ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.911 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[6]~_Duplicate_2  ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.904 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[10]~_Duplicate_2 ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.897 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[16]~_Duplicate_2 ; hex3[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.887 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[20]~_Duplicate_2 ; hex3[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.848 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[8]~_Duplicate_2  ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.713 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[14]~_Duplicate_2 ; hex3[6] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.678 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[18]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.665 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[1]~_Duplicate_2  ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.638 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[17]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.593 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[13]~_Duplicate_2 ; hex1[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.591 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[13]~_Duplicate_2 ; hex1[2] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.588 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[15]~_Duplicate_2 ; hex3[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.517 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[15]~_Duplicate_2 ; hex3[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.493 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[3]~_Duplicate_2  ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.481 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[16]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.471 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[20]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.421 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[15]~_Duplicate_2 ; hex3[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.317 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[18]~_Duplicate_2 ; hex3[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.297 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[14]~_Duplicate_2 ; hex3[5] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.277 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[17]~_Duplicate_2 ; hex3[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.246 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[18]~_Duplicate_2 ; hex3[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.206 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[17]~_Duplicate_2 ; hex3[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.150 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[18]~_Duplicate_2 ; hex3[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.147 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[4]~_Duplicate_2  ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.136 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[13]~_Duplicate_2 ; hex1[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.120 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[16]~_Duplicate_2 ; hex3[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.117 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[5]~_Duplicate_2  ; hex1[0] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.110 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[20]~_Duplicate_2 ; hex3[4] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.110 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[17]~_Duplicate_2 ; hex3[1] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.049 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[16]~_Duplicate_2 ; hex3[3] ; CLOCK      ;
; N/A                                     ; None                                                ; 17.039 ns  ; g07_Nth_Root:G0|Y_TRANSIANT[20]~_Duplicate_2 ; hex3[3] ; CLOCK      ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ;            ;                                              ;         ;            ;
+-----------------------------------------+-----------------------------------------------------+------------+----------------------------------------------+---------+------------+


+--------------------------------------------------------------------------+
; th                                                                       ;
+---------------+-------------+-----------+--------+------------+----------+
; Minimum Slack ; Required th ; Actual th ; From   ; To         ; To Clock ;
+---------------+-------------+-----------+--------+------------+----------+
; N/A           ; None        ; 0.541 ns  ; sw[1]  ; N_input[1] ; CLOCK    ;
; N/A           ; None        ; 0.518 ns  ; sw[0]  ; N_input[0] ; CLOCK    ;
; N/A           ; None        ; 0.411 ns  ; sw[2]  ; X_input[2] ; CLOCK    ;
; N/A           ; None        ; 0.409 ns  ; sw[2]  ; N_input[2] ; CLOCK    ;
; N/A           ; None        ; 0.167 ns  ; sw[0]  ; X_input[0] ; CLOCK    ;
; N/A           ; None        ; -0.022 ns ; sw[8]  ; resetS     ; CLOCK    ;
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; N/A           ; None        ; -5.690 ns ; key[0] ; N_input[5] ; CLOCK    ;
+---------------+-------------+-----------+--------+------------+----------+


+--------------------------+
; Timing Analyzer Messages ;
+--------------------------+
Info: *******************************************************************
Info: Running Quartus II Classic Timing Analyzer
    Info: Version 8.0 Build 215 05/29/2008 SJ Full Version
    Info: Processing started: Tue Nov 18 15:27:58 2008
Info: Command: quartus_tan --read_settings_files=off --write_settings_files=off g07_Nth_Root -c g07_Nth_Root --timing_analysis_only
Warning: Found pins functioning as undefined clocks and/or memory enables
    Info: Assuming node "CLOCK" is an undefined clock
Info: Clock "CLOCK" has Internal fmax of 90.87 MHz between source register "g07_Nth_Root:G0|Z_SHIFT[19]" and destination register "g07_Nth_Root:G0|Z[32]" (period= 11.005 ns)
    Info: + Longest register to register delay is 10.764 ns
        Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LCFF_X29_Y14_N7; Fanout = 25; REG Node = 'g07_Nth_Root:G0|Z_SHIFT[19]'
        Info: 2: + IC(0.934 ns) + CELL(3.637 ns) = 4.571 ns; Loc. = DSPMULT_X28_Y16_N0; Fanout = 1; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|mac_mult5~DATAOUT1'
        Info: 3: + IC(0.000 ns) + CELL(0.304 ns) = 4.875 ns; Loc. = DSPOUT_X28_Y16_N2; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|mac_out6~DATAOUT1'
        Info: 4: + IC(0.829 ns) + CELL(0.517 ns) = 6.221 ns; Loc. = LCCOMB_X29_Y16_N12; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[1]~47'
        Info: 5: + IC(0.000 ns) + CELL(0.174 ns) = 6.395 ns; Loc. = LCCOMB_X29_Y16_N14; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[2]~49'
        Info: 6: + IC(0.000 ns) + CELL(0.080 ns) = 6.475 ns; Loc. = LCCOMB_X29_Y16_N16; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[3]~51'
        Info: 7: + IC(0.000 ns) + CELL(0.080 ns) = 6.555 ns; Loc. = LCCOMB_X29_Y16_N18; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[4]~53'
        Info: 8: + IC(0.000 ns) + CELL(0.080 ns) = 6.635 ns; Loc. = LCCOMB_X29_Y16_N20; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[5]~55'
        Info: 9: + IC(0.000 ns) + CELL(0.080 ns) = 6.715 ns; Loc. = LCCOMB_X29_Y16_N22; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[6]~57'
        Info: 10: + IC(0.000 ns) + CELL(0.080 ns) = 6.795 ns; Loc. = LCCOMB_X29_Y16_N24; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[7]~59'
        Info: 11: + IC(0.000 ns) + CELL(0.080 ns) = 6.875 ns; Loc. = LCCOMB_X29_Y16_N26; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[8]~61'
        Info: 12: + IC(0.000 ns) + CELL(0.080 ns) = 6.955 ns; Loc. = LCCOMB_X29_Y16_N28; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[9]~63'
        Info: 13: + IC(0.000 ns) + CELL(0.161 ns) = 7.116 ns; Loc. = LCCOMB_X29_Y16_N30; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[10]~65'
        Info: 14: + IC(0.000 ns) + CELL(0.458 ns) = 7.574 ns; Loc. = LCCOMB_X29_Y15_N0; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|add9_result[11]~66'
        Info: 15: + IC(0.825 ns) + CELL(0.609 ns) = 9.008 ns; Loc. = LCCOMB_X30_Y16_N30; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|op_1~164'
        Info: 16: + IC(0.000 ns) + CELL(0.080 ns) = 9.088 ns; Loc. = LCCOMB_X30_Y15_N0; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|op_1~166'
        Info: 17: + IC(0.000 ns) + CELL(0.080 ns) = 9.168 ns; Loc. = LCCOMB_X30_Y15_N2; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|op_1~168'
        Info: 18: + IC(0.000 ns) + CELL(0.458 ns) = 9.626 ns; Loc. = LCCOMB_X30_Y15_N4; Fanout = 1; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult2|mult_1v01:auto_generated|op_1~169'
        Info: 19: + IC(0.864 ns) + CELL(0.178 ns) = 10.668 ns; Loc. = LCCOMB_X31_Y16_N0; Fanout = 1; COMB Node = 'g07_Nth_Root:G0|Selector47~19'
        Info: 20: + IC(0.000 ns) + CELL(0.096 ns) = 10.764 ns; Loc. = LCFF_X31_Y16_N1; Fanout = 3; REG Node = 'g07_Nth_Root:G0|Z[32]'
        Info: Total cell delay = 7.312 ns ( 67.93 % )
        Info: Total interconnect delay = 3.452 ns ( 32.07 % )
    Info: - Smallest clock skew is -0.002 ns
        Info: + Shortest clock path from clock "CLOCK" to destination register is 2.859 ns
            Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L1; Fanout = 1; CLK Node = 'CLOCK'
            Info: 2: + IC(0.238 ns) + CELL(0.000 ns) = 1.264 ns; Loc. = CLKCTRL_G2; Fanout = 165; COMB Node = 'CLOCK~clkctrl'
            Info: 3: + IC(0.993 ns) + CELL(0.602 ns) = 2.859 ns; Loc. = LCFF_X31_Y16_N1; Fanout = 3; REG Node = 'g07_Nth_Root:G0|Z[32]'
            Info: Total cell delay = 1.628 ns ( 56.94 % )
            Info: Total interconnect delay = 1.231 ns ( 43.06 % )
        Info: - Longest clock path from clock "CLOCK" to source register is 2.861 ns
            Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L1; Fanout = 1; CLK Node = 'CLOCK'
            Info: 2: + IC(0.238 ns) + CELL(0.000 ns) = 1.264 ns; Loc. = CLKCTRL_G2; Fanout = 165; COMB Node = 'CLOCK~clkctrl'
            Info: 3: + IC(0.995 ns) + CELL(0.602 ns) = 2.861 ns; Loc. = LCFF_X29_Y14_N7; Fanout = 25; REG Node = 'g07_Nth_Root:G0|Z_SHIFT[19]'
            Info: Total cell delay = 1.628 ns ( 56.90 % )
            Info: Total interconnect delay = 1.233 ns ( 43.10 % )
    Info: + Micro clock to output delay of source is 0.277 ns
    Info: + Micro setup delay of destination is -0.038 ns
Info: tsu for register "N_input[2]" (data pin = "key[0]", clock pin = "CLOCK") is 5.938 ns
    Info: + Longest pin to register delay is 8.835 ns
        Info: 1: + IC(0.000 ns) + CELL(0.864 ns) = 0.864 ns; Loc. = PIN_R22; Fanout = 9; PIN Node = 'key[0]'
        Info: 2: + IC(6.019 ns) + CELL(0.322 ns) = 7.205 ns; Loc. = LCCOMB_X32_Y14_N0; Fanout = 6; COMB Node = 'N_input[0]~135'
        Info: 3: + IC(0.872 ns) + CELL(0.758 ns) = 8.835 ns; Loc. = LCFF_X32_Y16_N31; Fanout = 3; REG Node = 'N_input[2]'
        Info: Total cell delay = 1.944 ns ( 22.00 % )
        Info: Total interconnect delay = 6.891 ns ( 78.00 % )
    Info: + Micro setup delay of destination is -0.038 ns
    Info: - Shortest clock path from clock "CLOCK" to destination register is 2.859 ns
        Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L1; Fanout = 1; CLK Node = 'CLOCK'
        Info: 2: + IC(0.238 ns) + CELL(0.000 ns) = 1.264 ns; Loc. = CLKCTRL_G2; Fanout = 165; COMB Node = 'CLOCK~clkctrl'
        Info: 3: + IC(0.993 ns) + CELL(0.602 ns) = 2.859 ns; Loc. = LCFF_X32_Y16_N31; Fanout = 3; REG Node = 'N_input[2]'
        Info: Total cell delay = 1.628 ns ( 56.94 % )
        Info: Total interconnect delay = 1.231 ns ( 43.06 % )
Info: tco from clock "CLOCK" to destination pin "hex0[2]" through register "g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2" is 23.228 ns
    Info: + Longest clock path from clock "CLOCK" to source register is 2.856 ns
        Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L1; Fanout = 1; CLK Node = 'CLOCK'
        Info: 2: + IC(0.238 ns) + CELL(0.000 ns) = 1.264 ns; Loc. = CLKCTRL_G2; Fanout = 165; COMB Node = 'CLOCK~clkctrl'
        Info: 3: + IC(0.990 ns) + CELL(0.602 ns) = 2.856 ns; Loc. = LCFF_X26_Y15_N17; Fanout = 6; REG Node = 'g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2'
        Info: Total cell delay = 1.628 ns ( 57.00 % )
        Info: Total interconnect delay = 1.228 ns ( 43.00 % )
    Info: + Micro clock to output delay of source is 0.277 ns
    Info: + Longest register to pin delay is 20.095 ns
        Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LCFF_X26_Y15_N17; Fanout = 6; REG Node = 'g07_Nth_Root:G0|Y_TRANSIANT[2]~_Duplicate_2'
        Info: 2: + IC(1.594 ns) + CELL(0.541 ns) = 2.135 ns; Loc. = LCCOMB_X27_Y17_N10; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult0|multcore:mult_core|romout[0][9]~2331'
        Info: 3: + IC(0.832 ns) + CELL(0.517 ns) = 3.484 ns; Loc. = LCCOMB_X26_Y17_N20; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult0|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~82'
        Info: 4: + IC(0.000 ns) + CELL(0.458 ns) = 3.942 ns; Loc. = LCCOMB_X26_Y17_N22; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult0|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~83'
        Info: 5: + IC(0.856 ns) + CELL(0.544 ns) = 5.342 ns; Loc. = LCCOMB_X25_Y17_N0; Fanout = 8; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult0|multcore:mult_core|mpar_add:padder|mpar_add:sub_par_add|lpm_add_sub:adder[0]|add_sub_6ch:auto_generated|op_1~447'
        Info: 6: + IC(0.631 ns) + CELL(0.513 ns) = 6.486 ns; Loc. = LCCOMB_X26_Y17_N10; Fanout = 1; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|romout[0][6]~988'
        Info: 7: + IC(1.199 ns) + CELL(0.517 ns) = 8.202 ns; Loc. = LCCOMB_X25_Y16_N4; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~313'
        Info: 8: + IC(0.000 ns) + CELL(0.080 ns) = 8.282 ns; Loc. = LCCOMB_X25_Y16_N6; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~315'
        Info: 9: + IC(0.000 ns) + CELL(0.080 ns) = 8.362 ns; Loc. = LCCOMB_X25_Y16_N8; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~317'
        Info: 10: + IC(0.000 ns) + CELL(0.080 ns) = 8.442 ns; Loc. = LCCOMB_X25_Y16_N10; Fanout = 2; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~319'
        Info: 11: + IC(0.000 ns) + CELL(0.458 ns) = 8.900 ns; Loc. = LCCOMB_X25_Y16_N12; Fanout = 30; COMB Node = 'g07_Nth_Root:G0|lpm_mult:Mult1|multcore:mult_core|mpar_add:padder|lpm_add_sub:adder[0]|add_sub_2ch:auto_generated|op_1~320'
        Info: 12: + IC(1.340 ns) + CELL(0.545 ns) = 10.785 ns; Loc. = LCCOMB_X23_Y15_N0; Fanout = 1; COMB Node = 'g07_segment_decoder:G1|a[2]~7626'
        Info: 13: + IC(0.338 ns) + CELL(0.521 ns) = 11.644 ns; Loc. = LCCOMB_X23_Y15_N10; Fanout = 1; COMB Node = 'g07_segment_decoder:G1|a[2]~7627'
        Info: 14: + IC(1.192 ns) + CELL(0.545 ns) = 13.381 ns; Loc. = LCCOMB_X24_Y16_N20; Fanout = 1; COMB Node = 'g07_segment_decoder:G1|a[2]~7628'
        Info: 15: + IC(0.787 ns) + CELL(0.521 ns) = 14.689 ns; Loc. = LCCOMB_X22_Y16_N0; Fanout = 1; COMB Node = 'g07_segment_decoder:G1|a[2]~7635'
        Info: 16: + IC(2.556 ns) + CELL(2.850 ns) = 20.095 ns; Loc. = PIN_F2; Fanout = 0; PIN Node = 'hex0[2]'
        Info: Total cell delay = 8.770 ns ( 43.64 % )
        Info: Total interconnect delay = 11.325 ns ( 56.36 % )
Info: th for register "N_input[1]" (data pin = "sw[1]", clock pin = "CLOCK") is 0.541 ns
    Info: + Longest clock path from clock "CLOCK" to destination register is 2.863 ns
        Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L1; Fanout = 1; CLK Node = 'CLOCK'
        Info: 2: + IC(0.238 ns) + CELL(0.000 ns) = 1.264 ns; Loc. = CLKCTRL_G2; Fanout = 165; COMB Node = 'CLOCK~clkctrl'
        Info: 3: + IC(0.997 ns) + CELL(0.602 ns) = 2.863 ns; Loc. = LCFF_X32_Y14_N25; Fanout = 3; REG Node = 'N_input[1]'
        Info: Total cell delay = 1.628 ns ( 56.86 % )
        Info: Total interconnect delay = 1.235 ns ( 43.14 % )
    Info: + Micro hold delay of destination is 0.286 ns
    Info: - Shortest pin to register delay is 2.608 ns
        Info: 1: + IC(0.000 ns) + CELL(1.026 ns) = 1.026 ns; Loc. = PIN_L21; Fanout = 2; PIN Node = 'sw[1]'
        Info: 2: + IC(1.169 ns) + CELL(0.413 ns) = 2.608 ns; Loc. = LCFF_X32_Y14_N25; Fanout = 3; REG Node = 'N_input[1]'
        Info: Total cell delay = 1.439 ns ( 55.18 % )
        Info: Total interconnect delay = 1.169 ns ( 44.82 % )
Info: Quartus II Classic Timing Analyzer was successful. 0 errors, 1 warning
    Info: Peak virtual memory: 135 megabytes
    Info: Processing ended: Tue Nov 18 15:28:00 2008
    Info: Elapsed time: 00:00:02
    Info: Total CPU time (on all processors): 00:00:01


